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Gowin SPI Flash Interface
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EDP Encode/ Decode
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Gowin DVI TX
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Gowin Scaler
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Gowin Video Frame Buffer with PSRAM
Video Interface
Gowin EDP PHY IP
Gowin LVDS7:1 RX LVDS4:1 TX
Gowin LVDS7:1 LCD Controller
スターターキットと開発ボード
OneKiwi 1P5
DK_USB_GW5AT-LV60UG225_V1.1
DK_USB_GW5ART-LV15MG132P_V1.1
DK_START_GW5AT-LV60PG484A_V1.1
DK_START_GW5AST-LV138FPG676A_V2.1
DK_USB_GW5AT-LV60UG225_V1.0
DK_DP_GW5AT-LV60UG225_V1.0
DK_EDP_GW5AT-LV15MG132_V1.0
DK_EDP_GW5ART-LV15MG132P_V1.0
DK_START_GW5AR-LV25UG256PC2I1_V1.0
DK_START_GW5A-LV25UG324_V1.0
DK_START_GW5AST-LV138FPG676A_V1.0
DK_Motor_GW5AS-EV25UG256C2I1_V1.1
DK_START_GW5A-LV25UG324_V2.0
DK_UAC2_GW1N-LV9LQ144C7I6_V2.1
[EOL] DK_START_GW5A-LV25UG324_V1.1
DK_START_GW2AN-UV9XUG400C7I6_V1.0
PCBパッケージ・ライブラリ
Gowin FPGA SCH Symbol
BSDL
Gowin Minimum FPGA System SCH
DK_START_GW1N-LV4LQ144C6I5_V1.1
ユーザーガイド
回路図
DK_START_GW1N-LV9EQ144C6I5_V2.1
DK_START_GW1NS-LV4CQN48C7I6_V1.1
ユーザーガイド
回路図
DK_START_GW5AT-LV138FPG676A_V2.0
DK_START_GW1NSR-LV4CQN48PC7I6_V1.1/ QN48GC7I6_V1.1
Schematic
DK_START_GW1NR-LV9LQ144PC6I5_V3.1
回路図
ユーザーガイド
DK_START_GW1NZ-LV1FN32C6I5_V3.1
ユーザーガイド
回路図
DK_START_GW2A-LV18PG256C8I7_V2.0
ユーザーガイド
デモ
回路図
DK_START_GW2A-LV55PG484C8I7_V1.3
Schematic
ユーザーガイド
DK_START_GW2AR-LV18EQ144PC8I7_V1.1
回路図
ユーザーガイド
DK_VIDEO_GW2A-LV18PG484C8I7_V1.2
Schematic
ユーザーガイド
DK_Motor_GW2A-LV55PG484C8I7_V3.0
GoAI 2.0
TEC0117
Ethernet MII Test Program
DK_USB2.0_GW2AR-LV18QN88PC8I7_GW1NSR-LV4CMG64PC7I6_V3.0
Quality Management
認証
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Product Change Notification (PCN)
Product Discontinuation Nofication (PDN)
Design Advisory
正誤表
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Gowin MCU Designer
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Gowin GoRV32 Pro
Gowin GoRV32
PicoRV32
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Embedded M3 Hard Core in GW1NS-2C
Embedded M3 Hard Core in GW1NS-4C
M1 Soft-Core
M3 Soft-Core
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Gowin USB 3.1 PHY

IP Introduction

Gowin USB 3.1 PHY IP is based on the USB3.1 protocol and is a USB3.1 physical layer transceiver that can support 10Gbps data transceiver.



Features

  • Support 10Gbps mode;
  • Support data serial-to-parallel and parallel-to-serial conversion;
  • Support 128b/132b encode and decode;
  • Support adding/removing scramble;
  • Support DC balance;
  • Support rx detection;
  • Support LFPS detection and sending;
  • Support PIPE (64bit) interface.
お問い合わせ サンプル